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單項(xiàng)選擇題

在VHDL中，一個(gè)設(shè)計(jì)實(shí)體可以擁有一個(gè)或多個(gè)（）。

A.設(shè)計(jì)實(shí)體
B.結(jié)構(gòu)體
C.輸入
D.輸出

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單項(xiàng)選擇題

在VHDL中，為定義的信號(hào)賦初值，應(yīng)該使用（）符號(hào)。

A.=：
B.=
C.：=
D.<=

單項(xiàng)選擇題

在VHDL中（）不能將信息帶出對(duì)它定義的當(dāng)前設(shè)計(jì)單元。

A.信號(hào)
B.常量
C.數(shù)據(jù)
D.變量

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