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單項(xiàng)選擇題

?已知某完全確定同步時(shí)序邏輯電路的原始狀態(tài)表，其中條件（）可以確定兩個(gè)狀態(tài)一定不等效。

A.輸出不同
B.次態(tài)相同
C.輸出相同
D.次態(tài)交錯(cuò)

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單項(xiàng)選擇題

?下圖所示CMOS電路是一個(gè)（）。

A.CMOS與非門
B.CMOS或非門
C.CMOS傳輸門
D.CMOS三態(tài)門

單項(xiàng)選擇題

?TTL與非門的（）反映了與非門的帶負(fù)載能力。

A.輸出高電平
B.輸出低電平
C.扇入系數(shù)
D.扇出系數(shù)

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